SYSTEM@TIC PARIS-REGION
http://www.systematic-paris-region.org
Les objectifs des projets FAME2 et POPS sont la conception de la prochaine génération de serveurs HPC et des outils logiciels pour le portage des applications sur ces machines massivement parallèles.
Des processeurs multicoeurs à mémoire partagée seront intégrés en clusters pour créer des serveurs qui répondent à la demande toujours plus forte de puissance de calcul.
L'objectif du projet PARA est d'étudier et de développer les méthodes d'optimisation qui exploitent au mieux tous les niveaux de parallélisme offerts par les nouvelles architectures de processeurs.
http://www.projet-para.uvsq.fr/?page_id=5
L'objectif principal du projet PARMAT, PARallélisation pour la simulation des MATériaux, est d'augmenter de façon significative la puissance d'applications de simulation en supprimant les goulets d'étranglement induits par la parallélisation du code. De nouveaux algorithmes qui s'adaptent aux machines massivement parallèles seront développés et testés, avec en vue les machines petaflopiques.
MINALOGIC, Grenoble
http://www.minalogic.org/en/index.htm
Le but du projet SCEPTRE est de développer une suite d'outils logiciels pour favoriser la mise en oeuvre des algorithmes multimédia dans un réseau de multiprocesseurs reconfigurables. Cette suite d'outils devrait notamment aider à l'exploration et l'analyse des choix logiciel / matériel. L'objectif est de réduire de façon drastique les temps de portage des applications et d'obtenir des réalisations flexibles sur une famille d'algorithmes, augmentant ainsi la durée de vie de chaque développement. Dans ce projet, CAPS étudie l'utilisation des co-processeurs spécifiques à une application.
http://www.systematic-paris-region.org
Les objectifs des projets FAME2 et POPS sont la conception de la prochaine génération de serveurs HPC et des outils logiciels pour le portage des applications sur ces machines massivement parallèles.
Des processeurs multicoeurs à mémoire partagée seront intégrés en clusters pour créer des serveurs qui répondent à la demande toujours plus forte de puissance de calcul.
L'objectif du projet PARA est d'étudier et de développer les méthodes d'optimisation qui exploitent au mieux tous les niveaux de parallélisme offerts par les nouvelles architectures de processeurs.
http://www.projet-para.uvsq.fr/?page_id=5
L'objectif principal du projet PARMAT, PARallélisation pour la simulation des MATériaux, est d'augmenter de façon significative la puissance d'applications de simulation en supprimant les goulets d'étranglement induits par la parallélisation du code. De nouveaux algorithmes qui s'adaptent aux machines massivement parallèles seront développés et testés, avec en vue les machines petaflopiques.
MINALOGIC, Grenoble
http://www.minalogic.org/en/index.htm
Le but du projet SCEPTRE est de développer une suite d'outils logiciels pour favoriser la mise en oeuvre des algorithmes multimédia dans un réseau de multiprocesseurs reconfigurables. Cette suite d'outils devrait notamment aider à l'exploration et l'analyse des choix logiciel / matériel. L'objectif est de réduire de façon drastique les temps de portage des applications et d'obtenir des réalisations flexibles sur une famille d'algorithmes, augmentant ainsi la durée de vie de chaque développement. Dans ce projet, CAPS étudie l'utilisation des co-processeurs spécifiques à une application.
MILEPOST est un projet financé par l'Union Européenne dont l'objectif est de développer des techniques de compilation qui apprennent automatiquement comment bien optimiser les applications à destination des processeurs reconfigurables hétérogènes embarqués.
http://www.milepost.eu/
PARMA est un projet fondé par ITEA2 qui inclut des acteurs du HPC de France, d'Allemagne, d'Espagne et du Royaume-Uni. L'objectif clé du consortium PARMA est d'aider la communauté HPC à pleinement tirer partie de l'évolution multi-cœur des processeurs tout en développant des technologies innovantes, flexibles et ouvertes .
http://www.parma-itea2.org/
http://www.milepost.eu/
PARMA est un projet fondé par ITEA2 qui inclut des acteurs du HPC de France, d'Allemagne, d'Espagne et du Royaume-Uni. L'objectif clé du consortium PARMA est d'aider la communauté HPC à pleinement tirer partie de l'évolution multi-cœur des processeurs tout en développant des technologies innovantes, flexibles et ouvertes .
http://www.parma-itea2.org/
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POLES DE COMPETITIVITE FRANCAIS
PROJETS EUROPEENS
IMAGES ET RÉSEAUX, Bretagne
http://www.images-et-reseaux.com
L'objectif du projet SCALIMAGE est d'étudier et de mettre en œuvre des techniques d'encodage flexibles. Cette nouvelle technologie de codage solutionne les problématiques de croissance exponentielle dans le volume de contenu transmis, de multiplication des plates-formes de réception, et de diversité des moyens de transport et de transmission. Dans ce projet, CAPS travaille sur les techniques d'optimisation de code.
SERENITEC a pour but d'analyser le code de l'application web sur la base de techniques d'analyses statiques et de connaissances antérieures stockées dans un système de raisonnement à partir de cas permettant de détecter des failles de sécurité et d'y apporter des corrections. Il vise à augmenter l'efficacité et la productivité de l'expert sans le remplacer.
http://www.images-et-reseaux.com
L'objectif du projet SCALIMAGE est d'étudier et de mettre en œuvre des techniques d'encodage flexibles. Cette nouvelle technologie de codage solutionne les problématiques de croissance exponentielle dans le volume de contenu transmis, de multiplication des plates-formes de réception, et de diversité des moyens de transport et de transmission. Dans ce projet, CAPS travaille sur les techniques d'optimisation de code.
SERENITEC a pour but d'analyser le code de l'application web sur la base de techniques d'analyses statiques et de connaissances antérieures stockées dans un système de raisonnement à partir de cas permettant de détecter des failles de sécurité et d'y apporter des corrections. Il vise à augmenter l'efficacité et la productivité de l'expert sans le remplacer.
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Leverage the computing power of GPUs and FPGAs co-processors
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